Fitter report for R_per6
Thu Sep 04 12:20:41 2008
Quartus II Version 8.0 Build 231 07/10/2008 Service Pack 1 SJ Web Edition


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; Table of Contents ;
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  1. Legal Notice
  2. Fitter Summary
  3. Fitter Settings
  4. Pin-Out File
  5. Fitter Resource Usage Summary
  6. Input Pins
  7. Output Pins
  8. All Package Pins
  9. Output Pin Default Load For Reported TCO
 10. Fitter Resource Utilization by Entity
 11. Non-Global High Fan-Out Signals
 12. Interconnect Usage Summary
 13. LAB Macrocells
 14. Logic Cell Interconnection
 15. Fitter Device Options
 16. Fitter Messages



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; Legal Notice ;
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Copyright (C) 1991-2008 Altera Corporation
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+----------------------------------------------------------------------+
; Fitter Summary                                                       ;
+-----------------------+----------------------------------------------+
; Fitter Status         ; Successful - Thu Sep 04 12:20:41 2008        ;
; Quartus II Version    ; 8.0 Build 231 07/10/2008 SP 1 SJ Web Edition ;
; Revision Name         ; R_per6                                       ;
; Top-level Entity Name ; R_per6                                       ;
; Family                ; MAX7000S                                     ;
; Device                ; EPM7064SLC44-10                              ;
; Timing Models         ; Final                                        ;
; Total macrocells      ; 1 / 64 ( 2 % )                               ;
; Total pins            ; 8 / 36 ( 22 % )                              ;
+-----------------------+----------------------------------------------+


+------------------------------------------------------------------------------+
; Fitter Settings                                                              ;
+--------------------------------------------+-----------------+---------------+
; Option                                     ; Setting         ; Default Value ;
+--------------------------------------------+-----------------+---------------+
; Device                                     ; EPM7064SLC44-10 ;               ;
; Use smart compilation                      ; Off             ; Off           ;
; Use TimeQuest Timing Analyzer              ; Off             ; Off           ;
; Optimize IOC Register Placement for Timing ; On              ; On            ;
; Limit to One Fitting Attempt               ; Off             ; Off           ;
; Fitter Initial Placement Seed              ; 1               ; 1             ;
; Slow Slew Rate                             ; Off             ; Off           ;
; Fitter Effort                              ; Auto Fit        ; Auto Fit      ;
+--------------------------------------------+-----------------+---------------+


+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in E:/3701/examples/R_per6/R_per6.pin.


+-----------------------------------------------------+
; Fitter Resource Usage Summary                       ;
+-----------------------------------+-----------------+
; Resource                          ; Usage           ;
+-----------------------------------+-----------------+
; Logic cells                       ; 1 / 64 ( 2 % )  ;
; Registers                         ; 0 / 64 ( 0 % )  ;
; Number of pterms used             ; 2               ;
; User inserted logic elements      ; 0               ;
; I/O pins                          ; 8 / 36 ( 22 % ) ;
;     -- Clock pins                 ; 0 / 2 ( 0 % )   ;
;     -- Dedicated input pins       ; 0 / 2 ( 0 % )   ;
; Global signals                    ; 0               ;
; Shareable expanders               ; 0 / 64 ( 0 % )  ;
; Parallel expanders                ; 0 / 60 ( 0 % )  ;
; Cells using turbo bit             ; 1 / 64 ( 2 % )  ;
; Maximum fan-out node              ; inst2~1         ;
; Maximum fan-out                   ; 1               ;
; Highest non-global fan-out signal ; inst2~1         ;
; Highest non-global fan-out        ; 1               ;
; Total fan-out                     ; 4               ;
; Average fan-out                   ; 0.44            ;
+-----------------------------------+-----------------+


+--------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                 ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; A_L  ; 40    ; --       ; 4   ; 1                     ; 0                  ; no     ; no             ; TTL          ; Fitter               ;
; B_L  ; 41    ; --       ; 4   ; 1                     ; 0                  ; no     ; no             ; TTL          ; Fitter               ;
; C    ; 4     ; --       ; 1   ; 1                     ; 0                  ; no     ; no             ; TTL          ; Fitter               ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+


+---------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                 ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
; Name ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load  ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+
; Y_L  ; 12    ; --       ; 1   ; no              ; no             ; no         ; no            ; TTL          ; Fitter               ; 10 pF ;
+------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------+


+-------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                      ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir.   ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1        ; 0          ; --       ; GND+           ;        ;              ;         ;                 ;
; 2        ; 1          ; --       ; GND+           ;        ;              ;         ;                 ;
; 3        ; 2          ; --       ; VCC            ; power  ;              ;         ;                 ;
; 4        ; 3          ; --       ; C              ; input  ; TTL          ;         ; N               ;
; 5        ; 4          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 6        ; 5          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 7        ; 6          ; --       ; TDI            ; input  ; TTL          ;         ; N               ;
; 8        ; 7          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 9        ; 8          ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 10       ; 9          ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 11       ; 10         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 12       ; 11         ; --       ; Y_L            ; output ; TTL          ;         ; N               ;
; 13       ; 12         ; --       ; TMS            ; input  ; TTL          ;         ; N               ;
; 14       ; 13         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 15       ; 14         ; --       ; VCC            ; power  ;              ;         ;                 ;
; 16       ; 15         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 17       ; 16         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 18       ; 17         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 19       ; 18         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 20       ; 19         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 21       ; 20         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 22       ; 21         ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 23       ; 22         ; --       ; VCC            ; power  ;              ;         ;                 ;
; 24       ; 23         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 25       ; 24         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 26       ; 25         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 27       ; 26         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 28       ; 27         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 29       ; 28         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 30       ; 29         ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 31       ; 30         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 32       ; 31         ; --       ; TCK            ; input  ; TTL          ;         ; N               ;
; 33       ; 32         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 34       ; 33         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 35       ; 34         ; --       ; VCC            ; power  ;              ;         ;                 ;
; 36       ; 35         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 37       ; 36         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 38       ; 37         ; --       ; TDO            ; output ; TTL          ;         ; N               ;
; 39       ; 38         ; --       ; RESERVED       ;        ;              ;         ;                 ;
; 40       ; 39         ; --       ; A_L            ; input  ; TTL          ;         ; N               ;
; 41       ; 40         ; --       ; B_L            ; input  ; TTL          ;         ; N               ;
; 42       ; 41         ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 43       ; 42         ; --       ; GND+           ;        ;              ;         ;                 ;
; 44       ; 43         ; --       ; GND+           ;        ;              ;         ;                 ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
Note: Pin directions (input, output or bidir) are based on device operating in user mode.


+-----------------------------------------------+
; Output Pin Default Load For Reported TCO      ;
+--------------+-------+------------------------+
; I/O Standard ; Load  ; Termination Resistance ;
+--------------+-------+------------------------+
; TTL          ; 10 pF ; Not Available          ;
+--------------+-------+------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.


+-------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity                                               ;
+----------------------------+------------+------+---------------------+--------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ; Library Name ;
+----------------------------+------------+------+---------------------+--------------+
; |R_per6                    ; 1          ; 8    ; |R_per6             ; work         ;
+----------------------------+------------+------+---------------------+--------------+


+---------------------------------+
; Non-Global High Fan-Out Signals ;
+---------+-----------------------+
; Name    ; Fan-Out               ;
+---------+-----------------------+
; A_L     ; 1                     ;
; C       ; 1                     ;
; B_L     ; 1                     ;
; inst2~1 ; 1                     ;
+---------+-----------------------+


+----------------------------------------------+
; Interconnect Usage Summary                   ;
+----------------------------+-----------------+
; Interconnect Resource Type ; Usage           ;
+----------------------------+-----------------+
; Output enables             ; 0 / 6 ( 0 % )   ;
; PIA buffers                ; 3 / 144 ( 2 % ) ;
+----------------------------+-----------------+


+----------------------------------------------------------------------+
; LAB Macrocells                                                       ;
+----------------------------------------+-----------------------------+
; Number of Macrocells  (Average = 0.25) ; Number of LABs  (Total = 1) ;
+----------------------------------------+-----------------------------+
; 0                                      ; 3                           ;
; 1                                      ; 1                           ;
+----------------------------------------+-----------------------------+


+-----------------------------------------+
; Logic Cell Interconnection              ;
+-----+------------+-------------+--------+
; LAB ; Logic Cell ; Input       ; Output ;
+-----+------------+-------------+--------+
;  A  ; LC1        ; C, B_L, A_L ; Y_L    ;
+-----+------------+-------------+--------+


+---------------------------------------------------------------+
; Fitter Device Options                                         ;
+----------------------------------------------+----------------+
; Option                                       ; Setting        ;
+----------------------------------------------+----------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off            ;
; Enable device-wide reset (DEV_CLRn)          ; Off            ;
; Enable device-wide output enable (DEV_OE)    ; Off            ;
; Enable INIT_DONE output                      ; Off            ;
; Configuration scheme                         ; Passive Serial ;
; Security bit                                 ; Off            ;
; Base pin-out file on sameframe device        ; Off            ;
+----------------------------------------------+----------------+


+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
    Info: Version 8.0 Build 231 07/10/2008 Service Pack 1 SJ Web Edition
    Info: Processing started: Thu Sep 04 12:20:40 2008
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off R_per6 -c R_per6
Info: Selected device EPM7064SLC44-10 for design "R_per6"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
    Info: Peak virtual memory: 152 megabytes
    Info: Processing ended: Thu Sep 04 12:20:43 2008
    Info: Elapsed time: 00:00:03
    Info: Total CPU time (on all processors): 00:00:01


